- 【Analyse 32 Canaux Haute Vitesse】L'analyseur logique USB LA5032 capture des signaux complexes avec 32 canaux synchrones à une fréquence d'échantillonnage de 500MHz, offrant une analyse temporelle précise avec une détection de glitch de 6.25ns pour le débogage avancé de applications MCU, ARM et FPGA.
- 【Mémoire Profonde avec Compression】Utilisez une profondeur d'échantillonnage massive de 10G par canal avec une technologie de compression avancée, soutenue par une mémoire matérielle de 5Gbits, pour capturer des flux de données de longue durée sans manquer d'événements critiques dans le développement de systèmes embarqués.
- 【Décodage Automatique de Protocoles】Décodez instantanément plus de 20 protocoles incluant MIPI DSI LP, I2C, SPI, UART, CAN et JTAG avec un logiciel intuitif qui traduit les données brutes en trafic bus lisible, accélérant considérablement votre flux de travail de débogage.
- 【Compatibilité Multi-Plateforme】Cet analyseur logique USB offre une compatibilité seamless avec Windows, Mac OS et Linux, des mises à jour logicielles automatiques et une interface conviviale adaptée à tous les niveaux de compétence.
- 【Solution de Débogage Complète】Générez des signaux de test avec le générateur PWM intégré (0.1-20MHz) et commencez le débogage immédiatement avec le kit complet contenant toutes les sondes, câbles de test et accessoires de connexion nécessaires.
- Assortiment complet de 60 valeurs : 1500 résistances à puce avec 60 valeurs de résistance de 0R à 10 m, 25 pièces par valeur, parfaites pour le prototypage, les tests et la réparation de circuits électroniques.
- Tolérance élevée de 1 % : offre une performance constante et fiable avec une tolérance serrée, adaptée pour les applications de conditionnement du signal et de division de tension.
- Design compact de taille 1206 : le kit de montage standard s'adapte aux circuits imprimés densément peuplés, parfait pour l'électronique moderne où l'efficacité de l'espace est importante.
- Large application électronique : utile dans la limitation de courant, l'adaptation d'impédance, les circuits d'alimentation et les projets de bricolage pour les étudiants, les amateurs et les ingénieurs.
- Compatibilité vérifiée : fonctionne parfaitement avec les processus de soudure et de refusion automatisés, prenant en charge une intégration efficace dans les flux de travail d'assemblage PCB standard.
- Puce principale : Lattice iCE40 série iCE40LP1k FPGA avec 1280 cellules logiques (LUT + flip-flop), 64K bit RAM (4K bit RAM x 16), PLL x 1 et 3 pilotes LED haut de gamme
- Débogueur ON-BOARD : débogueur iCELink avec programmation par glisser-déposer, port série CDC pour communiquer avec FPGA et horloge 12 MHz pour FPGA comme horloge externe
- Périphérique : USB de type C pour l'alimentation, le téléchargement et le débogage, 2 Mo SPI Flash W25Q16, un connecteur PMOD 2 x 6 broches et deux connecteurs PMOD 1 x 6 broches
- DIMENSIONS COMPACTES : la taille de la carte de 3,9 cm x 1,8 cm rend la planche idéale pour les projets peu encombrants et les applications mobiles
- OPEN SOURCE RISC-V : prend en charge le développement open source RISC-V avec interface PMOD standard pour une extensibilité facile et une compatibilité avec différents modules
- Puce FPGA : puce FPGA GW2AR-18 QN88 contenant 20736 cellules logiques LUT4 et 15552 filp-Flops. Il y a 2 PLL dans cette puce FPGA, et de nombreuses unités DSP prenant en charge la multiplication 18 bits x 18 bits
- [Débogueur intégré] La carte de développement Sipeed Tang Nano 20K prend en charge JTAG pour FPGA, USB vers UART pour FPGA, USB vers SPI pour communication FPGA, contrôle MS5351 génère de la fréquence
- Interface USB 2.0 HS : le cristal de 27 MHz génère l'horloge pour l'affichage HDMI, la puce de génération d'horloge MS5351 intégrée fournit également plusieurs horloges. Prend en charge la communication série, la réception SPI haute vitesse.
- [Scénarios d'application] La carte de développement Tang Nano 20K Open Source prend en charge les émulateurs de console de jeu, les écrans RVB, plusieurs sorties d'affichage, 20K LUT4, les expériences soft-core RISC-V.
- [Wiki] « https://dl.sipeed.com/shareURL/TANG/Nano_20K/1_Datasheet » ; Pour tout client après-vente, veuillez nous contacter en cliquant sur « Waypondev » magasin et poser une question ou laisser le message dans notre forum par « forum.youyeetoo .com/».
- FPGA ARTIX‑7 XC7A35T – Le silicium Xilinx série 7 offre une densité logique élevée, une faible consommation d'énergie, des émetteurs-récepteurs rapides, des blocs DSP robustes et des fonctionnalités AMS pour les projets DMA et embarqués exigeants.
- Interface USB‑C 3.2 FT601 – Obtenez jusqu'à 275 Mo/s de vitesse de lecture/écriture PCILeech sur une liaison USB 3.2, éliminant les goulots d'étranglement du chemin de données.
- JTAG USB‑C PLUG‑AND‑PLAY – Flash de nouveaux flux binaires ou micrologiciel via le port de mise à jour intégré ; aucun module JTAG externe ou câble ruban n'est nécessaire.
- Compatible PCILEECH : l'accès à la mémoire 64 bits et la prise en charge PCIe TLP fonctionnent dès la sortie de la boîte avec la boîte à outils PCILeech standard.
- Interrupteur d'alimentation pratique : la bascule marche/arrêt intégrée vous permet de désactiver la carte sans la retirer de votre système.
- Refroidissement double couche : le tampon thermique de précision sous un bouclier en aluminium robuste maintient le XC7A35T au frais, minimisant l'étranglement thermique lors des transferts soutenus à haute vitesse.
- Contenu de l'emballage : carte de développement FPGA avec FPGA EP4CE6E22, double oscillateurs, mémoire flash W25Q, puce d'interface série, LED utilisateur, boutons poussoirs et sélecteurs de tension réglables ; dimensions du circuit imprimé 8,8 x 5,1 cm.
- Double oscillateur et stabilité de l'horloge : la conception à double oscillateur fournit des sources d'horloge séparées et stables pour la logique du système et de l'utilisateur pour simplifier la séparation du domaine de l'horloge et prendre en charge une synchronisation fiable lors des simulations et des tests matériels réels.
- Options d'alimentation réglables : les broches de tension sélectionnables et la régulation intégrée vous permettent d'expérimenter différentes tensions IO et cœur en toute sécurité ; les en-têtes étiquetés facilitent la configuration des rails d'alimentation pour les périphériques.
- Outils de développement et interfaces : l'en-tête de programmation standard et la connectivité série UART prennent en charge les outils de téléchargement courants et les consoles série, permettant la programmation, la surveillance et le débogage progressif dans les flux de travail de développement.
- Applications et scénarios d'utilisateur : bien adapté pour les cours de laboratoire, le développement, les expériences de traitement du signal et les projets de fabricant; disposition compacte adaptée aux petits boîtiers; veuillez vérifier votre propre tableau des tailles plutôt que le tableau des tailles d'Amazon.
- La puce BL616 intégrée de téléchargeur FPGA JTAG et de port série pour la communication avec le FPGA.
- Tang Nano 20K est une carte mère utilisant Semiconductor GW2AR-18 QN88. La puce possède 20 736 tables de recherche logique (LUT4) et 15 552 registres (FF). Il y a deux PLL à l'intérieur et plusieurs unités . Prend en charge la multiplication 18 bits x 18 bits pour accélérer les opérations numériques.
- La carte utilise par défaut un oscillateur à cristal de 27 MHz pour multiplier l'horloge requise pour l'affichage compatible , et est également équipée d'une puce de génération d'horloge MS5351 pour générer une variété d'horloges requises à volonté.
- Il est doté d'une SDRAM intégrée de 64 Mbits à faible latence, ce qui facilite l'exécution de l'émulateur et facilite l'exécution des systèmes Linux soft-core.
- La puce de téléchargement intégrée a été mise à niveau vers une interface USB2.0 , avec les fonctions de téléchargement JTAG haute vitesse, de communication série, de réception SPI haute vitesse et de configuration précise de l'horloge.
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